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模擬芯片版圖設(shè)計(jì)培訓(xùn)

Generator設(shè)計(jì)培訓(xùn)課程班

5 （34人評(píng)價(jià)）

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課程簡(jiǎn)介

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教學(xué)優(yōu)勢(shì)

　曙海教育的課程培養(yǎng)了大批受企業(yè)歡迎的工程師。大批企業(yè)和曙海
建立了良好的合作關(guān)系。曙海教育的課程在業(yè)內(nèi)有著響亮的知名度。

　本課程，秉承19年積累的教學(xué)品質(zhì)，以項(xiàng)目實(shí)現(xiàn)為導(dǎo)向,老師將會(huì)與您分享設(shè)計(jì)的全流程以及工具的綜合使用經(jīng)驗(yàn)、技巧。

課程列表

課程簡(jiǎn)介：

Generator設(shè)計(jì)培訓(xùn)

課程大綱：

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- 課程目標(biāo)：
  
  課程對(duì)象
  對(duì) DSP 設(shè)計(jì)培訓(xùn)感興趣、正在利用 MathWorks MATLAB? 和 Simulink? 軟件實(shí)現(xiàn) DSP 算法以及希望使用 Xilinx System Generator for DSP 設(shè)計(jì)的系統(tǒng)工程師、系統(tǒng)設(shè)計(jì)者、邏輯設(shè)計(jì)者與有經(jīng)驗(yàn)的硬件工程師
  
  課程概要
  1、系統(tǒng)生成器簡(jiǎn)介
  Simulink 軟件基礎(chǔ)
  實(shí)驗(yàn)1：利用 Simulink 軟件
  Basic Xilinx Design Capture
  實(shí)驗(yàn)2：利用 Xilinx 系統(tǒng)生成器著手設(shè)計(jì)
  Signal Routing
  實(shí)驗(yàn)3：信號(hào)路由
  實(shí)現(xiàn)系統(tǒng)控制
  實(shí)驗(yàn)4：實(shí)現(xiàn)系統(tǒng)控制
  
  2、多速率系統(tǒng)
  實(shí)驗(yàn)5：設(shè)計(jì)基于 MAC 的 FIR
  Filter Design
  實(shí)驗(yàn)6：利用 FIR 編譯器模塊設(shè)計(jì) FIR 濾波器
  System Generator、 Vivado Design Suite、項(xiàng)目導(dǎo)航器和 XPS 集成
  實(shí)驗(yàn) 7:?System Generator 和 Vivado IDE 集成
  Kintex-7 FPGA DSP 平臺(tái)
  實(shí)驗(yàn) 8a:?System Generator 和 Vivado HLS 工具集成
  實(shí)驗(yàn) 8b:?AXI-4 Lite 接口綜合
  
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小巧又實(shí)用的技巧，再也不用一個(gè)一個(gè)手動(dòng)編寫命令了。
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課程最新筆記

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vlookup , the seach order does not to be sorted.
多余的空格的筆記
substitute(text, old_text, new_text)
去除分類軸上的空白的筆記
change the value of the axis cell from date to text - then there will be no consecutive dates populated automatically.
Design Compiler的學(xué)習(xí)筆記
Cake chart:show levels of cascaded information

課程最新問題

老師，第一課和第二課的資料下載后，怎么打開呢？
名詞解釋
請(qǐng)問老師上課的素材在哪下載？

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